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引用
UVM
序列
我已经创建了一个
UVM
序列来读取寄存器并在本地存储它们。现在在我的测试代码中,我需要访问这些寄存器。下面是一个sudo代码: int a; // registerto
uvm
db my_regs regs; task build_
浏览 6
提问于2016-09-21
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回答
UVM
详细覆盖
是否有一种方法可以覆盖已给出的任何详细的开关,并在
UVM
中强制使用不同的值?+
uvm
_set_verbosity=*abc*,_ALL_,
UVM
_FULL,run +
uvm
_set_verbosity=*sel*,_ALL_,
UVM
_FULL,run 例
浏览 7
修改于2022-04-05
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1
回答
用于
uvm
_events的参数化
uvm
_sequence
在我的验证环境中,我设置了一些可重用的公共序列: class common_sequence(type T =
uvm
_sequence) extends
uvm
_sequence#(
uvm
_sequence_itemclass common_sequence_with_event(type T =
uvm
_sequence, type E =
uvm
_event) extends
uvm
_sequence#(
uvm
_sequence_item(sequence
浏览 2
修改于2014-06-19
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回答
uvm
_component是如何在
uvm
_factory中注册的?
我最近开始研究
UVM
,并且很难理解工厂的组件/对象注册过程。具体来说,我找不到实际注册的代码行。以下是我的想法/搜索过程: 在
uvm
_component_registry类中有一个get方法,它创建代理对象me并通过factory.register(me)调用将其注册到工厂。在
浏览 15
提问于2021-07-14
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回答
SysteVerilog,
UVM
uvm
_reg_adapter。有没有办法用
uvm
_sequences代替
uvm
_sequence_item?
我必须为注册层创建适配器。我确实有访问总线的序列,我喜欢重用这些序列。当前适配器应该返回item,reg layer将执行start_item。有没有办法使用序列和注册层将做的只是开始。谢谢,
浏览 1
提问于2016-12-10
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1
回答
UVM
中的域分离
`include "
uvm
_macros.svh" import
uvm
_pkg::*; `
uvm
_component_utils(driver) `
uvm
_component_ut
浏览 0
修改于2022-01-26
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回答
UVM
相位单子
在浏览了一下
UVM
源代码之后,我注意到每个阶段都存在单例。对于运行阶段,可以通过调用
uvm
_run_phase::get()来访问。我尝试从
uvm
_run_phase::get()阶段和run_phase阶段调用end_of_elaboration,正如预期的那样,这两个调用都返回了同一个对象的句柄。
浏览 0
修改于2014-04-23
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3
回答
为什么
uvm
_transaction类总是从
uvm
_sequence_item扩展而来?
我正在学习
UVM
教程的基础知识。在我阅读的所有地方,事务对象总是从
uvm
_sequence_item而不是
uvm
_transaction扩展而来,因为
uvm
_sequence_item具有诸如transaction id等附加特性。如果是这样,为什么
uvm
_transaction类甚至在
UVM
类层次结构中?除了从
uvm
_transaction扩展的
uvm
_sequence_item之外,还有谁在使用
uvm
_sequence_item?
浏览 10
修改于2016-07-12
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回答
使用定义的详细级别(别名)进行
UVM
报告(使用
uvm
_info)
在
UVM
中,有预定义的详细级别:实际报告可以使用命令行参数来控制,例如+
UVM
_VERBOSITY=
UVM
_LOW(2)是否可以使用不同的优先级创建完全用户定义的详细级别? 在
UVM
_NONE和
UVM
_LOW之间说些什么,以及如何从
浏览 3
提问于2019-10-21
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1
回答
事务对象的
UVM
阶段
据我所知,
UVM
阶段,例如build_phase,connect_phases,只对
uvm
_component有效,并且是派生类。这意味着所有从
uvm
_transaction派生的类,即
uvm
_sequence,
uvm
_sequence_item都不支持这些阶段。在代码中,如果我们编写以下代码 `
uvm
_object_utils(setupSeq)
浏览 2
提问于2016-05-26
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1
回答
UVM
端口: put、get、导出、分析
我试图掌握
UVM
,并在
UVM
端口中完全丢失。请帮助更好地理解港口。 我的问题是: 哈克
浏览 15
修改于2016-01-22
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回答
在哪里使用
uvm
_blocking_put_port和
uvm
_analysis_port?
在哪里使用
uvm
_blocking_put_port,在哪里使用
uvm
_analysis_port?
uvm
_analysis_port相对于
uvm
_blocking_put_port的优势是什么?
浏览 2
提问于2016-06-28
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回答
为什么要继承
uvm
_*单元?
根据e
UVM
user guide,我正在实现一个验证环境。每个
uvm
_*到底有什么逻辑?我可以在不继承
uvm
_*单元的情况下实现
UVM
环境吗? 谢谢你的帮助
浏览 0
提问于2018-03-25
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3
回答
UVM
支持嵌套/内部类吗?
有时,其他一个
uvm
_object只需要一个
uvm
_component,因此,按照面向对象的理论,我们应该使用嵌套/内部类。class inception_level_1 extends
uvm
_test; class inception_level_2 ext
浏览 4
提问于2014-02-03
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2
回答
UVM
终端测试机制
task mabu_scoreboard::main_phase(
uvm
_phase phase); # 1ns; hit_rd_max_outstanding = 1; end else begin
浏览 6
修改于2022-05-07
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回答
uvm
_comparer
uvm
1.2的物理位和抽象位的用法
在
uvm
1.2库
uvm
_comparer.svh中,添加了两个过滤器位“物理”和“抽象”。谁能告诉我这些过滤比特的正确用法。
浏览 0
提问于2016-02-11
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2
回答
对
UVM
错误的支持
有没有一种简单的方法可以在不操作
UVM
库的情况下将自定义函数返回到
UVM
_ERROR宏?(例如,每当在环境中的任何地方调用
UVM
错误时,我都希望我的函数与它一起被调用)。
浏览 0
修改于2013-09-26
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1
回答
为什么
uvm
_top消失了?
本周,我编译了我的第一个IEEE 1800.2-2017
UVM
代码,惊讶地发现
uvm
_top已经不复存在。快速搜索IEEE 1800.2-2017年没有发现"
uvm
_top“,快速浏览一下源代码就会发现它确实已经消失了。以下是两种解决方法:comp =
uvm
_top.find("*.m_agent.m_seqr"); //
uvm
1.2comp =
uvm
_root::get().find(&quo
浏览 1
提问于2020-02-20
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回答
UVM
阶段查询
我有几个关于
UVM
阶段build()和run()的问题。它们可能适用于其他验证方法以及a>,为什么build()阶段是按自顶向下的顺序执行的。
浏览 9
修改于2018-08-30
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2
回答
UVM
中的多线程
我们如何在
UVM
中集成多线程。
UVM
测试平台中的线程、扩展的
UVM
组件、序列以及叉和连接之间的方法?
浏览 6
提问于2014-05-07
得票数 0
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