有人能解释δ周期如何影响VHDL模拟的波形吗?我知道这与VHDL如何确定优先级有关,但我不完全确定是如何确定优先级的。
发布于 2017-04-27 22:22:59
VHDL作为硬件描述语言,本质上是并行的,同时多个信号可以改变其值。但是,在CPU上对所述硬件的行为进行仿真,CPU按顺序执行命令,因此需要引入解释这种并行信号分配的机制,即Delta周期。
当某一信号改变其值时,实时停止并改变信号的值,而实时信号仍被停止,仿真以δ周期进行,并改变所有受此变化影响的其他信号的值。如果任何信号受到影响,则仿真将继续对所有其他受影响的信号进行另一个增量循环检查,并且只要所有受影响信号的值都保持静态,该过程就会以这种方式继续进行。只有这样,才能继续进行实时仿真。
https://stackoverflow.com/questions/43652630
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